دانلود مقاله Activity Aware Clock Gated Storage Element Design با pdf دارای 4 صفحه می باشد و دارای تنظیمات در microsoft word می باشد و آماده پرینت یا چاپ است
فایل ورد دانلود مقاله Activity Aware Clock Gated Storage Element Design با pdf کاملا فرمت بندی و تنظیم شده در استاندارد دانشگاه و مراکز دولتی می باشد.
این پروژه توسط مرکز مرکز پروژه های دانشجویی آماده و تنظیم شده است
توجه : در صورت مشاهده بهم ریختگی احتمالی در متون زیر ،دلیل ان کپی کردن این مطالب از داخل فایل ورد می باشد و در فایل اصلی دانلود مقاله Activity Aware Clock Gated Storage Element Design با pdf ،به هیچ وجه بهم ریختگی وجود ندارد
بخشی از متن دانلود مقاله Activity Aware Clock Gated Storage Element Design با pdf :
سال انتشار: 1390
محل انتشار: نوزدهمین کنفرانس مهندسی برق ایران
تعداد صفحات: 4
نویسنده(ها):
Hossein Karimiyan Alidash – University of Kashan,
Sayed Masoud Sayedi – ECE, Isfahan University of Technology, Isfahan, Iran, 84156-83111
چکیده:
In advanced sub-nanometer technologies,along with area and timing, power consumption is the major concern. Power consumption composed by different components and dynamic power is mostly the dominant component. Clock subsystem of a digital circuit has a large share in the dynamic power consumption which is mostly due to its high toggling rate and large capacitive loading. A new clock gating methodology for low-power clocked storage element design is presented. The proposed method removes unnecessary clock toggling and reduces capacitive loading, which both lead to reduced dynamic power and reduced design complexity. The proposed method is an ad-hoc method and does not require access to internal circuitry of storage element, which makes it feasible in the standard-cell based digital circuit design. The HSPICE simulation results conducted in 45nm CMOS technology confirm more than 20% less power consumption and higher activity-rate crossover point compared to ordinary clock gating methods.
- ۹۵/۰۸/۰۱